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基于存储条的非易失性多级存储器操作的制作方法
专利名称：基于存储条的非易失性多级存储器操作的制作方法
技术领域：
本发明大体来说涉及半导体存储器装置、方法及系统，且更具体来说涉及基于存储条(stripe)的非易失性多级存储器操作。
个以上实施例可包括如此指定的数个特定特征。本文中的诸图遵循一编号惯例，其中第一数字对应于图号且剩余数字识别图式中的元件或组件。可通过使用类似的数字来识别不同图之间的类似元件或组件。举例来说，108可参考图1中的元件“08”，且类似元件在图2中可参考为208。如将了解，可添加、交换及/或消除在本文中的各种实施例中所示的元件以便提供本发明的数个额外实施例。另夕卜，如将了解，诸图中所提供
的元件的比例及相对规模意图说明本发明的实施例，且不应以限制性意义来理解。图1为根据本发明的一个或一个以上实施例的计算系统100的功能性框图，所述计算系统100包括至少一个存储器系统104。在图1中所说明的实施例中，存储器系统104(例如，固态驱动器(SSD))可包括主机接口 106、存储器控制器108(例如，存储器控制电路及/或存储器控制固件)及一个或一个以上存储器装置110-1.....110-N(例如，包括非易失性多级存储器单元的固态存储器装置)。存储器装置110-1.....1lO-N可提供
用于存储器系统的存储容量(例如，通过经格式化成存储器装置的文件系统)。在一个或一个以上实施例中，存储器控制器108可为一耦合到包括物理主机接口 106及存储器装置110-1、...、110-N的印刷电路板的专用集成电路(ASIC)。如图1中所说明，存储器控制器108可通过多个沟道而耦合到主机接口 106及存
储器装置110-1.....110-N。如将由所属领域的技术人员所了解，除其它存储器操作外，存
储器控制器108还可经配置以执行本文中所描述的操作。主机接口 106可用以在存储器系统104与另一装置(例如主机系统102)之间传达信息。主机系统102可包括存储器存取装置(例如，处理器)。一般所属领域的技术人员将了解，“处理器”可意图用作一个或一个以上处理器，例如并行处理系统、数个协处理器等。主机系统的实例包括膝上型计算机、个人计算机、数字相机、数字记录及回放装置、移动电话、PDA、存储卡读取器、接口集线器及其类似者。对于一个或一个以上实施例来说，主机接口 106可呈标准化接口的形式。举例来说，当存储器系统104用于计算系统100中的信息存储时，物理主机接口 106可为串行高级技术附接(SATA)、高速外围组件互连(PCIe)或通用串行总线(USB)，还有其它连接器及接口。然而，一般来说，主机接口 106可提供用于在存储器系统104与具有用于主机接口 106的兼容接收器的主机系统102之间传递控制、地址、信息及其它信号的接口。存储器控制器108可包括可耦合到主机接口 106及/或并入到主机接口 106的主机接口电路。主机接口电路可经由数个层(例如，物理层、链接层及/或传输层)而与主机系统102介接。一般所属领域的技术人员将了解，可通过接口标准(例如串行高级技术附接(SATA)、高速外围组件互连(PCIe)、通用串行总线(USB)等)来定义特定主机接口的数个层。如本文中所使用，传输层可指示作为SATA标准的一部分的至少一传输层及/或作为