数字电子技术基础(第三版周良权).ppt

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时钟脉冲边沿触发的触发器
T触发器和T’触发器
基本RS触发器
第4章 集成触发器
触发器应用举例
202X
本章教学基本要求
要知道：触发器的工作特点、基本RS触发器功能，同步触发器特点，脉冲边沿触发器工作特点，T和T’触发器的功能。
会画出：与非门、或非门组成基本RS触发器的电路及逻辑符号图，上升边沿触发的D触发器、下边沿触发的JK触发器和逻辑符号图及其输出波形图，用JK和D触发器构成T’触发器的连线图。
会写出：RS触发器、D触发器、JK触发器的状态方程式。
会背出：JK触发器的输出Q的次态在CP下降沿作用下与输入JK状态的关系。
会使用：集成触发器直接置位、复位端SD、RD和 的状态在各种情况下的设置方法。
SD、RD
概 述
在数字电路系统中，经常采用触发器以及由它们与各种门电路一起组成的时序逻辑电路。
时序逻辑电路的特点是：输出状态不仅取决于当时的输入信号状态，而且还与原输出状态有关。
电路结构上存在反馈，使时序逻辑电路具有记忆功能，即在输入信号作用撤消后，能保持在输入信号作用时所具有的输出状态。
1
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触发器的分类方法有三种：
按有无动作的统一时间节拍（时钟脉冲）来分:有基本触发器（无时钟触发器）和时钟触发器。
按电路的结构来分:有主从触发器、维持阻塞触发器、边沿触发器和主从型边沿触发器等。
按逻辑功能来分:有 RS 触发器、D 触发器、JK 触发器、T 触发器、T’触发器。
触发器的基本特性
一个触发器可存储 1 位二进制数码
有两个稳定状态(简称稳态):用来表示逻辑 0 和 1。
在输入信号作用下，触发器的两个稳定状态可相互转换(称为状态的翻转)。输入信号消失后，新状态可长期保持下来，因此具有记忆功能，可存储二进制信息。
一、电路结构：
由两个与非门构成, 两个输出端,一个为Q,一个为 .正常情况下, 两个输出端是逻辑互补的,即一个为0,一个为1。两个输入输。“R”、“S”上面的非线,表示这种触发器输入信号为低电平有效.
基本 RS 触发器

1、有两个稳定的状态
当Q=1时,G1输入端全为1,则G1输出为0, G2输入端有0,则G2输出端为1。
当输入端全为1时,输出端不变
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规定：以Q输出端的状态为
触发器的状态
当Q=0时,G1输入端有0,则G1输出端为1, G2输入端全为1,则G2输出端为0
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0
当输入端全为1时,输出端不变
1、有两个稳定的状态
在低电平信号作用下,触发器可以从一个稳态转换到另一个稳态
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G1输入有0,则G1输出端为1, G2输入全为1,则Q=0.
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Q由1变为0
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置0端
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Q = 0
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单击此处输入你的正文
Q由0变为1
G2输入有0,则Q=1,G1输入全为1,则G1输出端为0
置1端
0
在低电平信号作用下,触发器可以从一个稳态转换到另一个稳态
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