EP3C40EDA实验说明书V1(一).doc

EDA/SOPC实验开发平台JC-SOPC-V实验指导书(EDA部分)北京杰创永恒科技有限公司目录前言1文档来自于网络搜索基础实验部分3文档来自于网络搜索实验一简单的QUARTUSII实例设计3文档来自于网络搜索实验二基于VHDL格雷码编码器的设计26文档来自于网络搜索实验三含异步清零和同步使能的加法计数器30文档来自于网络搜索实验四八位七段数码管动态显示电路的设计34文档来自于网络搜索实验五数控分频器的设计38文档来自于网络搜索实验六图形和VHDL混合输入的电路设计41文档来自于网络搜索实验七步长可变的加减计数器的设计46文档来自于网络搜索实验八四位并行乘法器的设计49文档来自于网络搜索实验九设计四位全加器52文档来自于网络搜索实验十可控脉冲发生器的设计55文档来自于网络搜索实验十一基本触发器的设计58文档来自于网络搜索应用实验部分61文档来自于网络搜索实验十二矩阵键盘显示电路的设计61文档来自于网络搜索实验十三16*16点阵显示实验67文档来自于网络搜索实验十四直流电机的测速实验73文档来自于网络搜索实验十五步进电机驱动控制79文档来自于网络搜索实验十六PS2接口键盘显示实验84文档来自于网络搜索实验十七VGA彩条信号发生器的设计91文档来自于网络搜索实验十八用VHDL设计七人表决器96文档来自于网络搜索实验十九用VHDL设计四人抢答器99文档来自于网络搜索实验二十正负脉宽调制信号发生器设计102文档来自于网络搜索综合设计实验105文档来自于网络搜索实验二一数字频率计的设计105文档来自于网络搜索实验二二多功能数字钟的设计111文档来自于网络搜索实验二三数字秒表的设计114文档来自于网络搜索实验二四出租车计费器的设计117文档来自于网络搜索实验二五基于VHDL的数码锁的设计120文档来自于网络搜索附表一:核心板上资源模块与FPGA的管脚连接表123文档来自于网络搜索附表二:系统板上资源模块与FPGA的管脚连接表129文档来自于网络搜索前言近十年由于超大规模集成电路和软件技术的快速发展,使数字系统集成到一片集成电路内成为可能,Altera、Xilinx、AMD等公司都推出了非常好的CPLD和FPGA产品,并为这些产品的设计配备了设计、下载软件,这些软件除了支持图形方式设计数字系统外,还支持设计多种数字系统的设计语言,使数字系统设计起来更加容易。在小规模数字集成电路就要淘汰的今天,作为一个电子技术工程技术人员不懂VHDL语言和CPLD、FPGA器件设计就象在计算机时代不会使用计算机一样可怕。文档来自于网络搜索本实验指导书的目的就是帮助读者学会设计数字系统,并熟悉Altera公司产品和软件QUARTUSⅡ及其它相关软件的使用。文档来自于网络搜索本实验指导书的实验内容从简单的组合电路的设计到复杂的数字系统的设计,详细的介绍了系统的设计方法和软件的各种操作。读者可以通过这本实验指导书设计自己的数字电路。文档来自于网络搜索本实验指导书选编了有代表性的实验近三十个,实验内容从简单到复杂,使使用者能够很快的入手,同时本实验指导书还可以作为电子技术的加深课程或作为电子技术工程师参考用书。文档来自于网络搜索本实验指导书配合JC-SOPC-VEDA/SOPC系统开发平台系列产品使用。如果用户有批评和建议可以和我们联系:文档来自于网络搜索E-mail:******@http:由于时间仓促,资料缺乏,有错误之处请读者原谅。编者基础实验部分实验一简单的QUARTUSII实例设计实验目的通过一个简单的3—8译码器的设计,掌握组合逻辑电路的设计方法。初步了解QUARTUSII原理图输入设计的全过程。掌握组合逻辑电路的静态测试方法。实验原理3-8译码器三输入,八输出。当输入信号按二进制方式的表示值为N时,输出端标号为N的输出端输出高电平表示有信号产生,而其它则为低电平表示无信号产生。因为三个输入端能产生的组合状态有八种,所以输出端在每种组合中仅有一位为高电平的情况下,能表示所有的输入组合。其真值表如表1-1所示文档来自于网络搜索输入输出ABCD7D6D5D4D3D2D1D00000000000100100000010010000001000110000100010000010000101001000001101000000**********表1-1三-八译码器真值表译码器不需要像编码器那样用一个输出端指示输出是否有效。但可以在输入中加入一个输出使能端,用来指示是否将当前的输入进行有效的译码,当使能端指示输入信号无效或不用对当前信号进行译码时,输出端全为高电平,表示无任何信号。本例设计中没有考虑使能输入端,自己设计时可以考虑加入使能输入端时,程序如何设计。文档来自于网络搜索实验内容在本实验中,用三个拨动开关来表示三八译码器的三个输入(A、B、C);用八个