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组合电路时序分析与自动化设计--数字电子技术基础课件.ppt

文档分类：高等教育 | 页数：约51页举报非法文档有奖

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文档列表 文档介绍

第5章
组合电路时序分析与自动化设计
传统数字电路设计技术存在的问题
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。
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4. 效率低成本高。
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。。
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现代数字系统自动设计流程
设计输入
图5-1 应用于FPGA/CPLD的EDA开发流程
设计输入
1. 图形输入
原理图输入
状态图输入
波形图输入
2. HDL文本输入
将使用了某种硬件描述语言(HDL)的电路设计文本,如VHDL或Verilog的源程序,进行编辑输入。
硬件描述语言
硬件描述语言VHDL和VerilogHDL在现在EDA设计中使用最多,也拥有几乎所有的主流EDA工具的支持。
VHDL在电子设计领域得到了广泛应用。
能将以VHDL语言描述数字系统的程序“翻译”成数字电路结构图文件的软件工具称为VHDL综合器。
综合
图5-2 计算机软/硬件描述语言编译/综合工具的不同之处
适配
图5-1 应用于FPGA/CPLD的EDA开发流程
时序仿真与功能仿真
编程下载
硬件测试
QuartusII简介
图5-3 Quartus II设计流程
原理图输入设计实例
电路原理图编辑输入
图5-4 选择编辑文件类型
(1)新建一个文件夹。
(2) 打开原理图编辑窗。
电路原理图编辑输入
图5-5 打开原理图编辑窗
(2) 打开原理图编辑窗。

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