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ADPCM语音编解码电路设计及FPGA实现
　　近年来,多媒体技术逐渐深化到人们的生活中。P3播放器已经成为流行的便携式音频播放设备,由于P3编码算法非常复杂,目前,一局部P3播放器的录音功能主要基于ADP算法和DSP来实现。本文阐述了AADPCM语音编解码电路设计及FPGA实现
　　近年来,多媒体技术逐渐深化到人们的生活中。P3播放器已经成为流行的便携式音频播放设备,由于P3编码算法非常复杂,目前,一局部P3播放器的录音功能主要基于ADP算法和DSP来实现。本文阐述了ADP语音编解码VLSI芯片的设计方法以及利用FPGA的硬件实现。ADP算法及其编解码器原理ADP(AdaptiveDifferentialPulsededulatin,自适应差分脉冲编码调制)综合了AP的自适应特性和DP系统的差分特性,是一种性能较好的波形编码。它的核心思想是:利用自适应改变量化阶的大小,即使用小的量化阶去编码小的差值,使用大的量化阶去编码大的差值,使用过去的样本值估算下一个输入样本的预测值,使实际样本值和预测值之间的差值总是最校ADP记录的量化值不是每个采样点的幅值,而是该点的幅值与前一个采样点幅值之差。ADP是利用样本与样本之间的高度相关性和量化阶自适应来压缩数据的一种波形编码技术。ADP标准是一个代码转换系统,它使用ADP转换技术实现64Kb/sA律或u律P(脉冲编码调制)速率和32Kb/s速率之间的互相转换。ADP的简化框图如图1所示。,采样率是8kHz,每个代码用8位表示,因此它的数据率为64Kb/s。而ADP的输出代码是“自适应量化器〞的输出,该输出是用4位表示的差分信号,它的采样率仍然是8kHz,它的数据率为32Kb/s,这样就获得了2:1的数据压缩。电路的整体构造基于ADP算法,可将语音编解码VLSI芯片分成编码、解码、存储、控制和时钟几个模块。编码模块实现数据压缩功能,将输入的P信号转换成ADP码,存储模块在控制模块的作用下,保存编码所得的ADP码,解码模块实现解压缩功能,将ADP码转换得到P码;控制模块的作用是控制其他模块的协调工作;时钟模块主要实现对外部晶振的原始时钟信号进展分频,以得到电路系统实际所需的时钟信号。电路整体构造如图2所示,其中En_en、En_de分别是编码和解码的使能信号,RST那么为复位信号。当E为“1〞时,RA写有效,而当E为“0〞时,RA读有效,S为“1〞时,RA可进展写或者读操作。电路设计过程本文采用Tp-dn方法进展电路设计。主要设计流程如下:首先基于VerilgHDL运用Ative-HDL进展电路的RTL级描绘和功能仿真,将经过功能仿真正确的程序在QuartusⅡ开发系统中进展综合和适配,接下来将得到的网表文件(.v)和具有时延信息的反标文件(.sd)调入delSiSE中,并参加所选器件相应的器件库进展时序仿真,时序仿真通过后,将QuartusII得到的“*.sf〞文件通过JTAG配置形式下载到FPGA中进展不可掉电的实际测试,也可将“*.pf〞文件通过AS配置形式下载到FPGA中进展可掉电的实际测试。电路系统的顶层程序如下。duleADP_TP(P_UT,P_IN,RERD,PLAY,LK,LK8K):paraeterADDR_IDTH=14;paraeterP_IDT